Cypress Semiconductor CYV15G0100EQ Fiche technique - Page 8
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LFI
RXLE
SDASEL
RXD7
RXD6
LPEN
RXD5
INSEL
RXD4
IN1+
RXD3
RXD2
RXD1
IN1−
RXD0
FRAMCHAR
RXOP
RXST2
RFEN
RXST1
RFMODE
DECMODE
RXST0
RXCLK+
RXCKSEL
RXCLK−
RXMODE
RXRATE
RXCLKC+
CYV15G0101DXB
Document Number: 001-12520 Rev. **
Figure 4. Interfacing CYV15G0100EQ to the HOTLink II SerDes
C D / M U T E
+3.3V
C10
0.01 μF
16
15
Z
0
14
13
2 Z
12
0
11
R18
10
Z
0
9
CYV15G0100EQ
M C L A D J
C L I
+3.3V
C12
0. 01 μF
1
C D / M U T E
C LI
2
V C C
V C C
3
V E E
V E E
4
S D O
S D I
5
S D O
S D I
6
V E E
V E E
7
M C L A D J
A G C +
8
A G C −
B Y P A S S
+
1 μF
C11
CYV15G0100EQ
BN C JAC K
1 μF
R16
C15
75Ω
75 Ω
1 μF
L2
C16
6.4 n H
37.4 Ω
75 Ω
R15
R14
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