DG FPGA Einrichtung - Seite 10

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DG FPGA Einrichtung
dg_toeudp25gip_fpgasetup_xilinx.doc
ii) Set programmable clock to 322.265625 MHz
a) VCU118 board: Set by using "VCU118 SCUI" application as shown in Figure 2-8.
b) KCU116 board: Set by using "KCU116 – Board User Interface" application as
shown in Figure 2-9.
7-Jun-21
Figure 2-8 Reference clock programming for VCU118
Figure 2-9 Reference clock programming for KCU116
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